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- 硬件電路：旁路電容/去耦電容的區(qū)別分析
- 本文作者是一位女工程師，作為一名偏軟件的嵌入式工程師，在硬件領(lǐng)域會(huì)碰到各種orz問題，此文為其工作中真是遇到的經(jīng)驗(yàn)記錄，希望對(duì)我們也有所啟發(fā)。
最近工作重心由軟件 - 2018-11-29 關(guān)注：172
- CPLD初學(xué)者入門知識(shí)總結(jié)
- CPLD按英語說是復(fù)雜可編程邏輯器件，對(duì)于一個(gè)硬件工程師來說，能應(yīng)用cpld技術(shù)是一個(gè)十分強(qiáng)大的能力。它的應(yīng)用可在根本上解決許多數(shù)字電路設(shè)計(jì)的問題，能大幅度改變?cè)O(shè)計(jì)思想
- 2018-11-29 關(guān)注：178
- 設(shè)置異步時(shí)鐘的問題解答
- 問題：2個(gè)頻率無關(guān)的時(shí)鐘，在sel的選擇下做切換。
有時(shí)一個(gè)看起來簡單，實(shí)際上是在考驗(yàn)ASIC工程師的問題。
1.簡單的講就是做信號(hào)的2選1么，那么我們就先做一個(gè)簡答的 - 2018-11-28 關(guān)注：188
- 儀表放大器的常見問題分析
- 儀表放大器被廣泛地應(yīng)用在現(xiàn)實(shí)世界中的資料截取。然而，設(shè)計(jì)工程師在使用它們時(shí)，卻經(jīng)常會(huì)出現(xiàn)不當(dāng)使用的情形。具體來說，盡管現(xiàn)代儀表放大器具有優(yōu)異的共模抑制CMR，但設(shè)計(jì)
- 2018-11-24 關(guān)注：546
- AD6.9的測(cè)試
- 很多工程師將完成的PCB圖直接交由制板廠制作，但是有時(shí)候制板廠轉(zhuǎn)換出來的gerber文件不是我們想要的。例如我們用的AD作出的圖，但是有的廠只用protel，那轉(zhuǎn)換出來的帶有漢字
- 2018-11-24 關(guān)注：167
- 串聯(lián)諧振特點(diǎn)分析
- 串聯(lián)諧振特點(diǎn)：電路呈純電阻性，端電壓和總電流同相，此時(shí)阻抗最小，電流最大，在電感和電容上可能產(chǎn)生比電源電壓大很多倍的高電壓，因此串聯(lián)諧振也稱電壓諧振。在電力工程
- 2018-11-24 關(guān)注：164
- 如何切斷2個(gè)頻率無關(guān)的時(shí)鐘？
- 問題：2個(gè)頻率無關(guān)的時(shí)鐘，在sel的選擇下做切換。
有時(shí)一個(gè)看起來簡單，實(shí)際上是在考驗(yàn)ASIC工程師的問題。
1.簡單的講就是做信號(hào)的2選1么，那么我們就先做一個(gè)簡答的 - 2018-11-24 關(guān)注：180
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